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N7EE01C - Architecture des calculateurs
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Que se passe-t-il si un périphérique d'E/S n'est pas correctement mappé dans l'espace adressable ?
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Pourquoi un processeur a-t-il besoin d'un bus de contrôle en plus du bus de données et du bus d'adresse ?
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Comment un périphérique d'E/S est-il vu par le processeur dans un système à espace adressable partagé ?
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Qu'est-ce qu'un "registre de contrôle" dans un périphérique d'E/S ?
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Quel est le rôle du bus d'adresse dans un système de décodage d'adresse ?
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Pourquoi utilise-t-on des registres d'échange dans les périphériques d'E/S ?
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Dans un système avec plusieurs types de mémoires, qu'est-ce que la signalisation "Chip Select" (CS) permet ?
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Si un processeur utilise 16 bits d'adresses, combien de cases mémoire peut-il adresser ?
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Pourquoi un système avec plusieurs types de mémoires nécessite-t-il un décodage d'adresses ?
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Dans un système avec plusieurs boîtiers de mémoire, comment l'espace adressable est-il alloué ?
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