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Systèmes élec. & informatiques (MESISI120424)
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Soit le sketch ci dessous:
Que vaut la distance (en mm) entre l'obstacle et et le capteur ultrason de distance HSR04
74HC74, quelle est l'affirmation fausse ?
- H = High-level = « 1 » logique
- L = Low-level = « 0 » logique
- I = Input
- O = Output
Une
tension en entrée > VIH est un H logique,
Une
tension en entrée < VIL est un L logique,
Le
comportement du composant n’est pas défini pour une tension intermédiaire
(entre VIL et VIH) !
74HC74, quelle est l'affirmation fausse ?
- H = High-level = « 1 » logique
- L = Low-level = « 0 » logique
- I = Input
- O = Output
- Une tension en entrée > VIH est un H logique,
- Une tension en entrée < VIL est un L logique,
- Le comportement du composant n’est pas défini pour une tension intermédiaire (entre VIL et VIH) !
74HC74, quelle affirmation est fausse ?
on peut générer un signal PWM sur la broche:
74HC74, quelle est l'affirmation fausse ?
int outPin = 9 ;
void setup() {
pinMode(outPin, OUTPUT);
} void loop() {
digitalWrite(outPin, HIGH);
delay(50);
digitalWrite(outPin, LOW);
delay(200);
}
Le rapport cyclique en %:
Soit le circuit suivant:
74HC393, quelle (es) affirmation (s) est fausse (s) ?
The 74HC/HCT393 are 4-bit binary ripple counters with separate clocks (1CP and 2 CP) and master reset (1MR and 2MR) inputs to each counter. The operation of each half of the "393" is the same as the "93" except no externalclock connections are required.The counters are triggered by a HIGH-to-LOW transition of the clock inputs. The counter outputs are internally connected to provide clock inputs to succeeding stages.
74HC393, quelle (es) affirmation (s) est fausse (s) ?
The 74HC/HCT393 are 4-bit binary ripple counters with separate clocks (1CP and 2 CP) and master reset (1MR and 2MR) inputs to each counter. The operation of each half of the "393" is the same as the "93" except no externalclock connections are required.The counters are triggered by a HIGH-to-LOW transition of the clock inputs. The counter outputs are internally connected to provide clock inputs to succeeding stages.